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ADC0834
El ADC0834 es un convertidor analógico a digital de aproximación sucesiva de 8 bits, equipado con un multiplexor multicanal configurable de entrada y entrada/salida en serie. La entrada/salida en serie está configurada para interactuar con registros de desplazamiento estándar o microprocesadores.
Secuencia de Operación
Una conversión se inicia configurando CS en bajo, lo que habilita todos los circuitos lógicos. CS debe mantenerse en bajo durante todo el proceso de conversión. Luego, se recibe una entrada de reloj del procesador. En cada transición de bajo a alto de la entrada de reloj, los datos en DI se desplazan al registro de dirección del multiplexor. El primer alto lógico en la entrada es el bit de inicio. Una palabra de asignación de 3 a 4 bits sigue al bit de inicio. En cada transición de bajo a alto del reloj de entrada, el bit de inicio y la palabra de asignación se desplazan a través del registro de desplazamiento. Cuando el bit de inicio se desplaza a la ubicación de inicio del registro del multiplexor, se selecciona el canal de entrada y comienza la conversión. La salida de estado de SAR (SARS) se pone en alto para indicar que una conversión está en progreso, y DI del registro de desplazamiento del multiplexor se deshabilita durante la duración de la conversión.
Se inserta automáticamente un intervalo de un período de reloj para permitir que el canal multiplexado seleccionado se estabilice. La salida de datos DO sale del estado de alta impedancia y proporciona un bajo inicial para este período de reloj de tiempo de estabilización del multiplexor. El comparador SAR compara salidas sucesivas de la escalera resistiva con la señal analógica entrante. La salida del comparador indica si la entrada analógica es mayor o menor que la salida de la escalera resistiva. A medida que avanza la conversión, los datos de conversión se envían simultáneamente desde el pin de salida DO, con el bit más significativo (MSB) primero.
Después de ocho períodos de reloj, la conversión se completa y la salida SARS se pone en bajo. Finalmente, se envían los datos con el bit menos significativo primero después de la secuencia de datos con el bit más significativo primero. .. image:: img/image175.png
Tabla de Lógica de Control de Dirección MUX del ADC0834